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References
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7077 /* 13140*/ OPC_CheckChild2CondCode, ISD::SETUGT,
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gen/lib/Target/XCore/XCoreGenDAGISel.inc 1777 /* 3083*/ OPC_CheckChild2CondCode, ISD::SETUGT,
include/llvm/CodeGen/ISDOpcodes.h 1060 return Code == SETUGT || Code == SETUGE || Code == SETULT || Code == SETULE;
lib/CodeGen/Analysis.cpp 213 case FCmpInst::FCMP_UGT: return ISD::SETUGT;
229 case ISD::SETOGT: case ISD::SETUGT: return ISD::SETGT;
249 case ICmpInst::ICMP_UGT: return ISD::SETUGT;
lib/CodeGen/SelectionDAG/DAGCombiner.cpp 8162 case ISD::SETUGT:
8469 CC == ISD::SETUGT && N0.hasOneUse() && isAllOnesConstant(N1) &&
12298 case ISD::SETUGT:
lib/CodeGen/SelectionDAG/LegalizeDAG.cpp 1688 case ISD::SETUGT:
3098 case ISD::UMAX: Pred = ISD::SETUGT; break;
3359 ISD::CondCode CC = IsAdd ? ISD::SETULT : ISD::SETUGT;
lib/CodeGen/SelectionDAG/LegalizeIntegerTypes.cpp 1275 case ISD::SETUGT:
2084 return std::make_pair(ISD::SETUGT, ISD::UMAX);
2317 Cond = ISD::SETUGT;
3037 SDValue HLUGT = DAG.getSetCC(dl, BoolNVT, ResultHL, HLLoMask, ISD::SETUGT);
3689 case ISD::SETUGT: LowCC = ISD::SETUGT; break;
3689 case ISD::SETUGT: LowCC = ISD::SETUGT; break;
3757 case ISD::SETUGT: CCCode = ISD::SETULT; FlipOperands = true; break;
lib/CodeGen/SelectionDAG/SelectionDAG.cpp 382 case ISD::SETUGT:
424 case ISD::SETOGT: Result = ISD::SETUGT ; break; // SETUGT & SETNE
2024 case ISD::SETUGT: return getBoolConstant(C1.ugt(C2), dl, VT, OpVT);
2086 case ISD::SETUGT: return getBoolConstant(R==APFloat::cmpGreaterThan ||
lib/CodeGen/SelectionDAG/SelectionDAGBuilder.cpp 2450 Sub, DAG.getConstant(JTH.Last - JTH.First, dl, VT), ISD::SETUGT);
2666 ISD::SETUGT);
lib/CodeGen/SelectionDAG/SelectionDAGDumper.cpp 409 case ISD::SETUGT: return "setugt";
lib/CodeGen/SelectionDAG/TargetLowering.cpp 364 case ISD::SETUGT:
2878 } else if (Cond == ISD::CondCode::SETUGT) {
3120 if ((Cond == ISD::SETULT && C1 == 2) || (Cond == ISD::SETUGT && C1 == 1)){
3302 case ISD::SETUGT:
3327 case ISD::SETUGT:
3508 ISD::CondCode NewCC = (Cond == ISD::SETGE) ? ISD::SETGT : ISD::SETUGT;
3558 if (Cond == ISD::SETGT || Cond == ISD::SETUGT) {
3589 if (Cond == ISD::SETUGT &&
3664 Cond == ISD::SETULE || Cond == ISD::SETUGT) {
3665 bool AdjOne = (Cond == ISD::SETULE || Cond == ISD::SETUGT);
3732 isCondCodeLegal(ISD::SETUGT, N0.getSimpleValueType()))
3733 return DAG.getSetCC(dl, VT, N0, N1, ISD::SETUGT);
3735 isCondCodeLegal(ISD::SETUGT, N0.getSimpleValueType()))
3899 case ISD::SETUGT: // X >u Y --> X == 1 & Y == 0 --> ~Y & X
5065 ((Cond == ISD::SETEQ) ? ISD::SETULE : ISD::SETUGT));
5285 ((Cond == ISD::SETEQ) ? ISD::SETULE : ISD::SETUGT));
7062 ISD::SETUGT);
7126 ISD::CondCode CC = IsAdd ? ISD::SETULT : ISD::SETUGT;
lib/Target/AArch64/AArch64ISelLowering.cpp 1444 case ISD::SETUGT:
1495 case ISD::SETUGT:
1569 case ISD::SETUGT:
1997 CC = (CC == ISD::SETULT) ? ISD::SETULE : ISD::SETUGT;
2014 case ISD::SETUGT:
lib/Target/AMDGPU/AMDGPUISelLowering.cpp 1309 case ISD::SETUGT: {
2453 SDValue RCmp = DAG.getSetCC(SL, SetCCVT, T, C, ISD::SETUGT);
lib/Target/AMDGPU/R600ISelLowering.cpp 131 setCondCodeAction(ISD::SETUGT, MVT::f32, Expand);
lib/Target/AMDGPU/SIISelLowering.cpp 9804 (CC == ISD::SETNE || CC == ISD::SETUGT || CC == ISD::SETLT)))
lib/Target/AMDGPU/SIInsertSkips.cpp 228 case ISD::SETUGT:
lib/Target/ARC/ARCISelLowering.cpp 45 case ISD::SETUGT:
lib/Target/ARM/ARMISelLowering.cpp 1806 case ISD::SETUGT: return ARMCC::HI;
1831 case ISD::SETUGT: CondCode = ARMCC::HI; break;
4200 CC = (CC == ISD::SETULT) ? ISD::SETULE : ISD::SETUGT;
4212 case ISD::SETUGT:
4275 CC == ISD::SETUGT && isa<ConstantSDNode>(LHS.getOperand(1)) &&
4619 else if (CC == ISD::SETUGT || CC == ISD::SETOGT || CC == ISD::SETOLT ||
4638 CC == ISD::SETUGT) {
6232 case ISD::SETUGT: Swap = true; LLVM_FALLTHROUGH;
6275 case ISD::SETUGT: Opc = ARMCC::HI; break;
14133 (CC == ISD::SETUGT && Imm == 0) ||
lib/Target/AVR/AVRISelLowering.cpp 520 case ISD::SETUGT: {
lib/Target/BPF/BPFISelLowering.cpp 688 SET_NEWCC(SETUGT, JUGT);
lib/Target/Hexagon/HexagonISelLoweringHVX.cpp 891 PickHi = DAG.getSetCC(dl, MVT::i1, IdxV, HalfV, ISD::SETUGT);
lib/Target/Lanai/LanaiISelLowering.cpp 820 case ISD::SETUGT:
lib/Target/MSP430/MSP430ISelLowering.cpp 1064 case ISD::SETUGT:
lib/Target/Mips/MipsISelLowering.cpp 620 case ISD::SETUGT: return Mips::FCOND_UGT;
lib/Target/Mips/MipsSEISelLowering.cpp 265 setCondCodeAction(ISD::SETUGT, MVT::f32, Expand);
270 setCondCodeAction(ISD::SETUGT, MVT::f64, Expand);
366 setCondCodeAction(ISD::SETUGT, Ty, Expand);
402 setCondCodeAction(ISD::SETUGT, Ty, Expand);
961 case ISD::SETUGT:
lib/Target/NVPTX/NVPTXISelDAGToDAG.cpp 560 case ISD::SETUGT:
lib/Target/PowerPC/PPCISelDAGToDAG.cpp 3039 case ISD::SETUGT:
3212 case ISD::SETUGT:
3368 case ISD::SETUGT:
3531 case ISD::SETUGT:
3793 case ISD::SETUGT:
3820 case ISD::SETUGT:
3859 case ISD::SETUGT: return PPC::PRED_GT;
3891 case ISD::SETUGT: return 1;
3911 case ISD::SETUGT: CC = ISD::SETULT; Swap = true; break;
3955 case ISD::SETULT: CC = ISD::SETUGT; Swap = true; break;
3963 case ISD::SETULE: CC = ISD::SETUGT; Negate = true; break;
3989 case ISD::SETUGT:
4277 if (InnerCC == ISD::SETULT || InnerCC == ISD::SETUGT) {
4324 case ISD::SETUGT:
4834 SelectCC(LHS, RHS, IsUnCmp ? ISD::SETUGT : ISD::SETGT, dl);
lib/Target/PowerPC/PPCISelLowering.cpp 489 setCondCodeAction(ISD::SETUGT, MVT::f32, Expand);
490 setCondCodeAction(ISD::SETUGT, MVT::f64, Expand);
893 setCondCodeAction(ISD::SETUGT, MVT::f128, Expand);
7290 case ISD::SETUGT:
7329 case ISD::SETUGT:
7804 Cond, DAG.getConstant(1, dl, MVT::i64), ISD::SETUGT);
12005 case ISD::SETUGT:
15545 case ISD::SETUGT:
lib/Target/RISCV/RISCVISelLowering.cpp 144 ISD::SETOGT, ISD::SETOGE, ISD::SETONE, ISD::SETUEQ, ISD::SETUGT,
338 case ISD::SETUGT:
lib/Target/Sparc/SparcISelLowering.cpp 1375 case ISD::SETUGT: return SPCC::ICC_GU;
1399 case ISD::SETUGT: return SPCC::FCC_UG;
lib/Target/SystemZ/SystemZISelLowering.cpp 1945 CONV(GT);
2471 else if (Cond == ISD::SETGT || Cond == ISD::SETUGT)
2619 case ISD::SETUGT:
lib/Target/WebAssembly/WebAssemblyISelLowering.cpp 89 ISD::SETULT, ISD::SETULE, ISD::SETUGT, ISD::SETUGE})
lib/Target/X86/X86ISelLowering.cpp 4676 case ISD::SETUGT: return X86::COND_A;
4726 case ISD::SETUGT:
4748 case ISD::SETUGT: // flipped
20476 case ISD::SETUGT: SSECC = 6; break;
20601 case ISD::SETUGT: {
20724 case ISD::SETUGT:
20806 if (Cond == ISD::SETUGT) {
20824 case ISD::SETUGT: Invert = true; LLVM_FALLTHROUGH;
24926 SDValue Cmp = DAG.getSetCC(DL, SetCCResultType, X, Add, ISD::SETUGT);
24932 SDValue Cmp = DAG.getSetCC(DL, SetCCResultType, X, Y, ISD::SETUGT);
25010 case ISD::UMAX: CC = ISD::CondCode::SETUGT; break;
36888 case ISD::SETUGT:
36930 case ISD::SETUGT:
37116 if ((CC == ISD::SETUGE || CC == ISD::SETUGT) &&
37130 if (CC == ISD::SETUGT && Other->getOpcode() == ISD::ADD &&
lib/Target/X86/X86InstrInfo.cpp 2319 case ISD::SETUGT: